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[求助]JTAG连接问题。
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[求助]JTAG连接问题。

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如图,我是用的一个BF532芯片的设备。设备的jtag接口是个2.0间距的,所以只能靠线和oplink连接。

目前我测量设备的jtag,和上图除第五脚外一样。第五脚是接地的。

也就是说双排插针,左边一排全部接地,右边接dsp。

我的问题是是否可以直接只连接右边这排信号到dsp?

目前是这么连接的。但是新建session后,最后一步finish完成,软件假死在那里。

问题:
1,如果是jtag连接问题,请问还需要增加什么连线。

2. 如何进行检测,发现是哪里的问题。



这家伙很懒,什么也没有留下!
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2016/7/25 16:01:13
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目前把5脚也连接到一起了。依然没有反应。

oplink发烫,这个现象是正常的是吧?

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2016/7/25 16:14:53
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第五脚定义为 BTMS/VDDIO
功能是用于感知连接芯片的JTAG电平。一些高端仿真器会使用到这个管脚,通常不使用,默认为3.3V。
ADI官方开发板会把这个管脚加一个下拉电阻到地,是加一个下拉电阻到地,并非直接接地。目的是为了检测JTAG接口是否有设备插入,如果插入,他们板上的仿真模块会切换到JTAG这端,否则会使用板上仿真。
我们在设计时,通常是加上拉电阻到你的系统电源。或者悬空,应该影响也不大。但是,不能直接接地。

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2016/7/25 16:18:43
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谢谢,因为我手头设备当前是接地的。所以我可以悬空此引脚继续仿真对吧?
可是目前只连接右侧的7根信号线,没法建立硬件连接,还有什么办法可以检测故障?


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2016/7/25 16:26:19
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andy(论坛版主)
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如果你只链接右边7根,你看一下板卡上4脚的地和1脚是不是通的,通的就没问题。
另外,根据官方EE68 ,JTAG接口要加3个10K上拉电阻,和1个4.7K下拉,你确认下板卡上相关管脚是否增加这些电阻。

JTAG 连接通常是通过VDSP的test测试确认。
你首先确认板卡上系统电源和内核电源电压正常,处理器复位管脚电平为3.3V,处理器时钟工作正常。
然后板卡上电,仿真器上电,看设备管理器仿真器驱动是否安装好,最后再打开软件。

如果你用test测试,第一步不通过,就板卡断电,仿真器断电,软件关闭,再按上面步骤重新来一次。不要急于连接软件,先测试。
测试前三步是仿真器自检,第四步是板卡的硬件连接,第五步是数据测试。
第四步不过,就检查板卡的硬件。按上面所说的查。

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2016/7/25 17:00:11
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他用的是oplink,test的那个工具好像没有这个type选项,这个检测貌似没办法进行。如果检测仿真器,只能是拿一个标准JTAG设计的正常工作的原厂的ezkit或者我们的533板来session链接测试。

我是OP...
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2016/7/25 17:02:10
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那先检查接口上下拉电阻焊接没有吧,
还有设计中处理器关键信号的处理,如ADRY,BR等是否接上下拉电阻。

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2016/7/25 17:08:04
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目前板子左侧的 1,3,5,7,9,11,13,和4脚,都是接地的。

6,8,12是通过10k电阻上拉接电源

10是通过10k电阻连接GND。


用示波器测量,2,4,14,脚低电平。 ,6,8,10,12,是高电平。

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2016/7/25 17:35:33
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另外我用的是vdsp的4.5版本。

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  201672517393098.png [ 33.30 KB 586×457 ] (缩略时请点击查看原图)

 



下面图是点finish后的卡死界面
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  201672517423698.jpg [ 72.96 KB 1280×800 ] (缩略时请点击查看原图)

 


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这个需要实际拿板子来调调看了

我是OP...
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